SDRAM-張明敏-20190722

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發(fā)布時間: 2019-7-23 00:00

這個作業(yè)沒有按時完成快了三個星期，我上次看過了相關DDR視頻，看過了同學做的案例，因為我對SDRAM扇出布線不成熟。首先請鄭老師，先看看我畫板是不是有哪些問題，我最開始設置好了6個層，和規(guī)則設置好了線寬，安 ...

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回復 Kivy 發(fā)表于 2019-7-23 14:01:35

等長方面可以滿足了3W原則請繼續(xù)吧地址線控制線時鐘線連接好建議按照T點設計

回復 Kivy 發(fā)表于 2019-7-23 14:00:28

按照T點走線不用再額外打孔了直接在中間那排孔那邊去進行連接就可以了

回復 Kivy 發(fā)表于 2019-7-23 13:58:50

走線同組同層這個問題還沒有完全滿足