AD 4層 CAN-FADE板評(píng)審報(bào)告20190401

凡億劉老師

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沒(méi)有原理圖，只能對(duì)pcb主要部分進(jìn)行檢查；

一．布局問(wèn)題：

二．布線問(wèn)題：

1.【問(wèn)題分析】：晶振的不局和走線存在問(wèn)題。

【問(wèn)題改善建議】：晶振走線布局都要考慮π型濾波，且它是個(gè)干擾源，建議包地隔離。

2.【問(wèn)題分析】：pcb中多處使用fill；這樣會(huì)產(chǎn)生直角，且fill不會(huì)避讓，容易出錯(cuò)。

【問(wèn)題改善建議】：建議電源處使用銅皮。

3.【問(wèn)題分析】：如下圖所示，pcb中存在多處直角，容易產(chǎn)生不良信號(hào)反射，影響信號(hào)。

【問(wèn)題改善建議】：建議使用fill填補(bǔ)成鈍角，或者添加淚滴。

4.【問(wèn)題分析】：電源層的平面分割比較嚴(yán)重，不利于參考，且容易出現(xiàn)跨區(qū)域現(xiàn)象。

【問(wèn)題改善建議】：建議小電源可以頂?shù)讓犹幚�，大電源在電源層處理，盡量保持平面完整。

5.【問(wèn)題分析】：

【問(wèn)題改善建議】：建議頂?shù)讓臃蟮劂~，可以在空閑處打上回流地孔，縮短回流路徑。

6.【問(wèn)題分析】：兩邊大銅皮，中間窄線連接，會(huì)出現(xiàn)電流瓶頸的情況，電流過(guò)載，容易燒壞。

【問(wèn)題改善建議】：建議中間使用寬銅皮連接，保證載流能力。

[size=12.0000pt]7. 【問(wèn)題分析】：時(shí)鐘線信號(hào)重要，且容易受到影響，pcb中間距不夠。

【問(wèn)題改善建議】：建議對(duì)時(shí)鐘線進(jìn)行包地處理或者與其他信號(hào)線保證3W的間距。

8.【問(wèn)題分析】：如下圖的信號(hào)，設(shè)計(jì)者定義的是電源信號(hào)，卻用信號(hào)線的寬度的線連接，載流不夠，會(huì)出現(xiàn)瓶頸。

【問(wèn)題改善建議】：建議加粗，或使用銅皮連接。

三．生產(chǎn)工藝：

1.【問(wèn)題分析】：所有過(guò)孔開(kāi)窗，生產(chǎn)后，這些過(guò)孔裸露的部分容易被腐蝕氧化，出現(xiàn)短路的現(xiàn)象。

【問(wèn)題改善建議】：建議對(duì)過(guò)孔進(jìn)行蓋油處理。

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王惠雄

這些錯(cuò)誤我經(jīng)常會(huì)犯，學(xué)習(xí)了！