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[作業(yè)已審核] 弟子計劃學員-方泊淋-DDR3模塊作業(yè)

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發(fā)表于 2020-2-24 23:18:50 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式
  4片DDR3模塊要點總結:
一、電源模塊:
1.DCDC電源模塊,布局時要注意主干道并且采用L形進行布局;
2.優(yōu)先輸入/輸出主干道;
3.濾波器件要采用先大后小的原則;
4.銅皮上打上過孔便于散熱。
二、DDR模塊
1.四片DDR同層,采用大T+小T的方式相對于CPU對稱,(多看視頻)
2.數(shù)據(jù)線每11根走在同一層——嚴格同組同層,(D0-D7,LDQM0,LDQS0,LDQS#);
3.地址線,數(shù)據(jù)線滿足3W原則,等長原則;
4.差分對誤差范圍控制在5mil;數(shù)據(jù)線誤差范圍在15mil;地址線誤差范圍在     100mil。
   在做工程之前,還有好多細節(jié)需要處理,orcad原理圖轉成AD版本以及網(wǎng)標的導入等等,視頻真的很有用,很細節(jié)。請鄭老師審閱,謝謝!

DDR3-DEMO.PcbDoc

5.59 MB, 下載次數(shù): 4, 下載積分: 聯(lián)盟幣 -5

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發(fā)表于 2020-3-1 23:14:21 | 只看該作者


狹長的銅 要記得進行挖空

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發(fā)表于 2020-3-1 23:16:00 | 只看該作者


進步很大 你這個處理得沒啥太大的問題
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發(fā)表于 2020-3-2 10:38:09 | 只看該作者
Kivy 發(fā)表于 2020-3-1 23:16
進步很大 你這個處理得沒啥太大的問題

謝謝鄭老師
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