Atium Designer原理圖生成PCB,取消room空間的辦法？

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Atium Designer原理圖生成PCB,取消room空間的辦法？

從原理圖生成PCB時，總會生成一個或者多個網(wǎng)絡(luò)區(qū)域，如圖6-166所示。這個區(qū)域Room在一般情況下沒有什么作用，反而對我們的設(shè)計會帶來一些不便，那么怎么樣可以取消此區(qū)域（Room空間）。

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王湯

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