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[已解答問題] 在原理圖導(dǎo)入到PCB中的時(shí)候顯示Unkonwpin,怎么解決

[復(fù)制鏈接]
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發(fā)表于 2016-12-21 17:12:14 | 只看該作者
nange 發(fā)表于 2016-8-16 17:32
可以把這個(gè)加上是  :因?yàn)樵韴D中的很多網(wǎng)絡(luò)已經(jīng)更新到PCB了 ,打開你創(chuàng)建的PCB,  design里選netlist,edi ...

我也遇到過就是之前導(dǎo)入是OK的,修改了原理圖再導(dǎo)到PCB上就出現(xiàn)了這個(gè)問題。
應(yīng)該按你這個(gè)方法可以搞定。
謝謝分享經(jīng)驗(yàn)。

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發(fā)表于 2016-12-21 18:14:31 | 只看該作者
來學(xué)習(xí)下,充電

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發(fā)表于 2016-12-29 16:44:45 | 只看該作者
我畫PCB都是直接倒過去的,很多時(shí)候會(huì)碰到這種情況,原因之一是庫沒有完全匹配,或者你有很多個(gè)庫,但封裝所在的庫原理圖對應(yīng)的,可以直接強(qiáng)行導(dǎo)一下。如果能夠過去就沒問題,如果還是報(bào)錯(cuò)就檢查吧

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發(fā)表于 2016-12-29 16:45:23 | 只看該作者

我畫PCB都是直接倒過去的,很多時(shí)候會(huì)碰到這種情況,原因之一是庫沒有完全匹配,或者你有很多個(gè)庫,但封裝所在的庫不是原理圖對應(yīng)默認(rèn)的,可以直接強(qiáng)行導(dǎo)一下。如果能夠過去就沒問題,如果還是報(bào)錯(cuò)就檢查吧

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發(fā)表于 2017-2-28 13:58:22 | 只看該作者
實(shí)用貼,學(xué)習(xí)了。

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發(fā)表于 2017-3-7 00:18:23 | 只看該作者
看看論壇,弄清了以前的問題

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發(fā)表于 2017-4-11 15:26:27 | 只看該作者
領(lǐng)教 學(xué)習(xí) 哈哈 學(xué)習(xí)了

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發(fā)表于 2017-4-11 21:12:46 | 只看該作者
受教了,贊

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發(fā)表于 2017-4-18 22:00:48 | 只看該作者
這個(gè)是什么原因

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發(fā)表于 2017-8-23 10:30:35 | 只看該作者
無回帖,不論壇,這才是人道。

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