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[作業(yè)已審核] T972PCB設計+劉用華

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發(fā)表于 2024-9-20 17:39:34 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式
作業(yè)文件名稱:T972_20240920.brd

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發(fā)表于 2024-9-23 11:41:41 | 只看該作者
這里的走線不能串到DDR里面去。調(diào)整下


該會員沒有填寫今日想說內(nèi)容.
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發(fā)表于 2024-9-23 11:41:51 | 只看該作者
其它已經(jīng)做的問題不大了
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發(fā)表于 2024-9-24 16:32:16 | 只看該作者
收到,謝謝黃老師了,我還在改,改好了再發(fā)給您看一下
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