Cadence allegro 17.2 3DPCB設(shè)計詳解教程 轉(zhuǎn)發(fā)

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眾所周知，Cadence allegro 16.x 版本已經(jīng)擁有3D view，雖然比較簡單，但是總之還不錯，近年以來Cadence公司在不斷的加強 PCB Editor三維的顯示能力，可以幫助PCB工程師更直觀進(jìn)行pcb設(shè)計。終于，17.2版本的到來，迎來了Cadence Allegro 3D設(shè)計的新紀(jì)元，其3D效果絲毫不弱于AD軟件的3D View。

一、準(zhǔn)備：allegro17.2 ，3D模型庫

二、設(shè)置及顯示

1、 首先要對使用環(huán)境進(jìn)行設(shè)置

1）  env文件設(shè)置。路徑在：Cadence\SPB_16.6\share\pcb\text\env，打開，查看是否有設(shè)置set step_unsupported_prototype 1，如果沒有，就在文件中加上。

2）  Step模型路徑設(shè)置。如下圖示：

2、 設(shè)置PCB中的元器件與3D模型匹配

1）進(jìn)入匹配界面。如下圖示：

2）匹配設(shè)置

file:///C:\Users\win7\AppData\Local\Temp\ksohtml\wpsFD45.tmp.png

分別在上圖示位置選擇需要顯示3d效果的器件進(jìn)行匹配，對各參數(shù)進(jìn)行設(shè)置以達(dá)到理想效果。設(shè)置好后

點擊Save進(jìn)行保存。然后可點擊Report進(jìn)行查看匹配結(jié)果。如下圖示

：

file:///C:\Users\win7\AppData\Local\Temp\ksohtml\wpsFD77.tmp.png

3、顯示設(shè)置。

1）顯示之前必須把相應(yīng)的層打開。

PACKAGE GEOMETRY/PLACE_BOUND_TOP

PACKAGE GEOMETRY/PLACE_BOUND_BOTTOM

MANUFACTURING/STEP3D_ASSEMBLY_ENCLOSURE

2）設(shè)置3d顯示查看效果。

file:///C:\Users\win7\AppData\Local\Temp\ksohtml\wpsFD78.tmp.png

file:///C:\Users\win7\AppData\Local\Temp\ksohtml\wpsFD99.tmp.png

到這個步驟，漂亮的3D就做出來了，是不是很漂亮，那你也來試試吧！

詳情可見www.sz-jlc.com/s

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ht2021

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