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[PCB技術(shù)] Cadence Allegro 在做PCB設(shè)計時,怎么導(dǎo)出DXF結(jié)構(gòu)文件呢?

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發(fā)表于 2021-4-23 10:43:57 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式

Cadence allegro 在做pcb設(shè)計時,怎么導(dǎo)出DXF結(jié)構(gòu)文件呢?
答:在上一問中我們講解了PCB設(shè)計過程中,我們?nèi)绾螌⒔Y(jié)構(gòu)工程師繪制的DXF文件導(dǎo)入到PCB中,那反過來,我們在PCB布局完成之后,需要核對結(jié)構(gòu)是否有問題,是否滿足要求,需要導(dǎo)出DXF文件,也是可以的,下面就詳細(xì)介紹一下,如何通過Allegro軟件,導(dǎo)出DXF結(jié)構(gòu)文件,具體的操作如下:
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Cadence Allegro 在做PCB設(shè)計時,怎么導(dǎo)出DXF結(jié)構(gòu)文件呢?
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