網(wǎng)傳華為校招通用硬件題，挺難的

硬件筆記本

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2 d6 e2 \8 Y4 j/ H8 A  c" C0 X8 a華為通用硬件：30道單項(xiàng)選擇，每題2分；10道不定項(xiàng)選擇，每題4分，少選不得分；總分100，60及格。
! t7 N" I! S4 t, v  W& v: t) J考核內(nèi)容：數(shù)電 模電 電力電子 微機(jī)原理 計(jì)算機(jī)網(wǎng)絡(luò) 磁技術(shù) 材料 通信原理等
考核難度：個(gè)人覺得對于一個(gè)本科生還是比較難的，很多東西學(xué)校里接觸不到

例題
3 G, y6 C; L7 B1. 三角波通過什么運(yùn)算電路可以轉(zhuǎn)換為正弦波（低通濾波器）
2. 下列哪個(gè)邏輯運(yùn)算式錯(cuò)誤：A+1=A A*A=A
# C9 H9 d+ X5 E1 w. R3. 在Vgs可用電壓范圍內(nèi)，Vgs越大，MOSFET漏源導(dǎo)通電阻的變化是變小。
4. 下面哪個(gè)電路屬于組合邏輯電路：計(jì)數(shù)器 移位寄存器 譯碼器 觸發(fā)器
  V7 l! E: p3 I' E% ^$ U5. 相嚙合的標(biāo)準(zhǔn)齒輪，小輪的齒根厚度與大輪的齒根厚度相比(大齒輪的齒根厚度大)
6 k1 ^% H" C: D1 Y" ]3 ]$ j8 k" \【解析】一對相嚙合的標(biāo)準(zhǔn)齒輪中,小齒輪的齒根厚度小于大齒輪的齒根厚度,而小齒輪的工作條件往往比大齒輪惡劣,故容易損壞。關(guān)注公眾號：硬件筆記本
6. 下列不能用帶使能端的二進(jìn)制譯碼器實(shí)現(xiàn)的有：多路數(shù)據(jù)分配器 地址譯碼器 七段數(shù)字顯示譯碼驅(qū)動(dòng) 計(jì)數(shù)器
7. 基于IA 64架構(gòu)的軟件可以運(yùn)行在 IA32位數(shù)的處理器上（錯(cuò)）
8. N形的半導(dǎo)體的多子是自由電子，所以它帶負(fù)電荷（錯(cuò)）
9. 對板料進(jìn)行多次拉伸時(shí)，為了消除形變強(qiáng)化，中途應(yīng)進(jìn)行：完全退火 再結(jié)晶退火 正火
8 B. G" l5 }% c. s9 P: @$ Z10. Cache的寫策略一般包括 write back和write through 兩種前者減少了對內(nèi)存的訪問，所以性能更高（對）
2 d6 ?1 }: G6 ~3 A! H# v+ W【解析】Write back 是只是寫到Cache中，并不會(huì)馬上寫到memory中，只有當(dāng)Cache被替換掉的時(shí)候，才會(huì)進(jìn)行寫到memory中，效率高，但是結(jié)構(gòu)復(fù)雜。Write through 就干脆的多，直接寫到memory中。結(jié)構(gòu)簡單，但是效率低。
! x, [$ l, \6 ]: |11. 模擬鎖相環(huán)電路中，與鑒相器參考信號 R相連 并且與運(yùn)放正輸入相連的是：up信號 vco壓控信號 down信號。關(guān)注公眾號：硬件筆記本
4 l4 e- K1 A2 \& _12. 動(dòng)態(tài)心電圖使用的ECG帶寬是0.05-40HZ 0.05-50HZ 0.05-150HZ 0.5-40Hz
13.計(jì)算機(jī)的字長是指 數(shù)據(jù)長度 CPU的數(shù)據(jù)總線的寬度 cpu內(nèi)部一次可以處理的二進(jìn)制數(shù)的位數(shù)
$ X- a0 S9 A8 ^, [1 h. A3 x14.若y(t)=f(t)*h(t) 那么 f(2t)*h(2t)等于 Y(2T)/2
15.關(guān)于 PCB的設(shè)置，以下描述錯(cuò)誤的是 器件面下面（第二層）優(yōu)先設(shè)置地面層 優(yōu)先采用對稱結(jié)構(gòu)設(shè)計(jì) 盡量避免兩個(gè)信號層直接相鄰 電源層離底層越遠(yuǎn)越好
16.考慮單板12V總線最低電壓不超過8v。如果12V輸入上跌落最長400us，負(fù)載最大電流10A,則12v總線上的電容最小為：1000UF 2500UF 500UF 1500UF
17.電源紋波噪聲哪種測量方式最準(zhǔn)確？無源探頭+示波器設(shè)置為50ohm DC模式 無源探頭+示波器設(shè)置為 1Mohm AC模式 同軸線覽 + 10uf電容隔直+ 示波器設(shè)置為50ohm +DC模式 有源探頭 +示波器設(shè)置為50ohm DC模式
18.對于二進(jìn)制信號傳輸來說，波特率在數(shù)值上等于比特率（正確）
19.數(shù)字電路設(shè)計(jì)中經(jīng)常采用地址的高位譯碼器來產(chǎn)生芯片的片選（正確）
8 s1 a! F2 X9 a( z' n20.溫度升高，熔體的表面張力一般將（減少）
21.正常情況下，脈沖的下降沿Tf的時(shí)間值應(yīng)該在下述的那個(gè)條件下測量 在脈沖峰峰值的10%到90% 在脈沖峰峰值的0到90% 在脈沖的峰峰值的10%到100% 在脈沖的峰峰值的0到100%

22.疲勞破壞是由于裂紋擴(kuò)展引起的（正確）
) T1 L8 g! z3 T( }5 a' r9 O23.在數(shù)字邏輯電路的設(shè)置中，要避免引起”競爭”，可以采用以下的那些方式（）
0 c) |4 V: u  h( C; tA 在電路中增加延時(shí)邏輯
B 采用同步時(shí)序電路
1 G7 s2 |( e) X" w: LC 采用異步時(shí)序電路
D 修改狀態(tài)轉(zhuǎn)換表
; l- T/ A2 L6 G+ M% |7 `24.計(jì)算機(jī)網(wǎng)絡(luò)的物理層具有那些功能。關(guān)注公眾號：硬件筆記本
A 定義報(bào)文的差錯(cuò)控制特性
B 定義接口的信號電氣特性
( T/ Q( `1 v% Q3 e; \# H+ }C 定義連接器的機(jī)械特性
D 定義報(bào)文的路由特性
( L- d4 @2 {9 b% m6 b0 @& u. {25.下面關(guān)于DMA傳輸方式，正確的有
A 需要DMA控制器參與傳輸
B 具有傳輸速度快，降低CPU的負(fù)載的優(yōu)點(diǎn)
/ \" \* D& _' h3 i3 |# D* IC 傳輸前后不需要有CPU的參與
4 a" {( u. E/ E  m* u% y" xD 計(jì)算機(jī)系統(tǒng)的地址總線，數(shù)據(jù)總線，控制總線在CPU和DMA 控制器之間復(fù)用。
26.DRAM上電時(shí)存儲單元的內(nèi)容是全0，而Flash上電時(shí)存儲單元的內(nèi)容是全1。（錯(cuò)誤）
! u: I( k, H( ]0 c+ d% o" w27.眼圖可以用來分析高速信號的碼間干擾、抖動(dòng)、噪聲和衰減。（正確）
28.以太網(wǎng)交換機(jī)將沖突域限制在每個(gè)端口，提高了網(wǎng)絡(luò)性能。（正確）
29.放大電路的輸出信號產(chǎn)生非線性失真是由于電路中晶體管的非線性引起的。（正確）
30.1的8位二進(jìn)制補(bǔ)碼是0000_0001,-1的8位二進(jìn)制補(bǔ)碼是 1111_1111。（正確）
31.洗衣機(jī)，電冰箱等家用電器都使用三孔插座，是因?yàn)槿绻�不接地，家用電器是不能工作的�?strong>（錯(cuò)誤）
0 v" f" @% F/ k- `1 v32.十進(jìn)制數(shù)據(jù)0x5a與0xa5的同或運(yùn)算結(jié)果為：0x00。（正確）
33.硅二極管的正向?qū)�通壓降比鍺二極管的大 （正確）
8 N9 G! r6 F, m1 M: Q: D34.一空氣平行板電容器，兩級間距為d，充電后板間電壓為u。然后將電源斷開，在平板間平行插入一厚度為d/3的金屬板。此時(shí)電容器原板間電壓變?yōu)?U/3
35.8086CPU內(nèi)部包括哪些單元 EU,BIU
7 B8 K( d7 n8 ]6 T1 d( A36.為了避免50Hz的電網(wǎng)電壓干擾放大器，應(yīng)該用哪種濾波器：帶阻濾波器
: }+ _, x  U' ?37.關(guān)于SRAM和DRAM，下面說話正確的是：DRAM使用內(nèi)部電容來保存信息 SRAM需要定時(shí)刷新，否則數(shù)據(jù)會(huì)丟失 SRAM的集成度高于DRAM 只要不掉電，DRAM內(nèi)的數(shù)據(jù)不會(huì)丟失
【解析】SRAM和DRAM都是隨機(jī)存儲器，機(jī)器掉電后，兩者的信息都將丟失。它們的最大區(qū)別就是：DRAM是用電容有無電荷來表示信息0和1，為防止電容漏電而導(dǎo)致讀取信息出錯(cuò)，需要周期性地給電容充電，即刷新；而SRAM是利用觸發(fā)器的兩個(gè)穩(wěn)態(tài)來表示信息0和1，所以不需要刷新。另外，SRAM的存取速度比DRAM更高，常用作高速緩沖存儲器Cache。DRAM的集成度要高。因?yàn)镾RAM需要更大的體積。關(guān)注公眾號：硬件筆記本
( }2 S* I8 T& R# j( H( T4 b1 ?( \38.在RS232串口中，采用哪一種校驗(yàn)方式：奇偶校驗(yàn)
39.對于D觸發(fā)器來說，為了保證可靠的采樣，數(shù)據(jù)必須在時(shí)鐘信號的上升沿到來之前繼續(xù)穩(wěn)定一段時(shí)間，這個(gè)時(shí)間稱為: 保持時(shí)間 恢復(fù)時(shí)間 穩(wěn)定時(shí)間 建立時(shí)間
【解析】setup/hold time 是測試芯片對輸入信號和時(shí)鐘信號之間的時(shí)間要求.建立時(shí)間是指觸發(fā)器的時(shí)鐘信號上升沿到來以前數(shù)據(jù)穩(wěn)定不變的時(shí)間輸入信號應(yīng)提前時(shí)鐘上升沿 (如上升沿有效)T時(shí)間到達(dá)芯片這個(gè)T就是建立時(shí)間-Setup time.如不滿足setup time,這個(gè)數(shù)據(jù)就不能被這一時(shí)鐘打入觸發(fā)器只有在下一個(gè)時(shí)鐘上升沿?cái)?shù)據(jù)才能被打入觸發(fā)器
保持時(shí)間是指觸發(fā)器的時(shí)鐘信號上升沿到來以后數(shù)據(jù)穩(wěn)定不變的時(shí)間如果hold time 不夠數(shù)據(jù)同樣不能被打入觸發(fā)器
建立時(shí)間 (Setup Time)和保持時(shí)間 (Hold time).建立時(shí)間是指在時(shí)鐘邊沿前數(shù)據(jù)信號需要保持不變的時(shí)間保持時(shí)間是指時(shí)鐘跳變邊沿后數(shù)據(jù)
40.本征半導(dǎo)體中加入（）元素可形成N型半導(dǎo)體 五價(jià)
5 `0 B6 z9 n% C! F' s+ B5 u4 f【解析】摻雜3價(jià)的原子形成P性，摻雜5價(jià)格的形成N形半導(dǎo)體
41.在Buck電路中，不能起到減小紋波作用的措施是 采用多項(xiàng)并聯(lián)的模式 開關(guān)管內(nèi)置，提高電源的開關(guān)頻率 輸出濾波電容由陶瓷電容改為容量電解電容 增大輸出濾波電感量
42.關(guān)于PCI總線的描述，錯(cuò)誤的是: PCI總線是一個(gè)16位寬的總線 PCI的地址線與數(shù)據(jù)線是復(fù)用的 PCI是一種獨(dú)立于處理器的總線標(biāo)準(zhǔn)，可以支持多種處理器 PCI支持即插即用功能
4 ~  I% u( d& s【解析】總線寬度為32/64位
$ u8 h+ c& U# a- [1 e4 h+ k43.中繼器、以太網(wǎng)交換機(jī)、路由器分別工作在OSI模型的哪位層次上：物理層、鏈路層、網(wǎng)絡(luò)層
【解析】
物理層: 將數(shù)據(jù)轉(zhuǎn)換為可通過物理介質(zhì)傳送的電子信號 相當(dāng)于郵局中的搬運(yùn)工人
數(shù)據(jù)鏈路層: 決定訪問網(wǎng)絡(luò)介質(zhì)的方式 在此層將數(shù)據(jù)分幀，并處理流控制。本層指定拓?fù)浣Y(jié)構(gòu)并提供硬件尋 址。相當(dāng)于郵局中的裝拆箱工人
網(wǎng)絡(luò)層: 使用權(quán)數(shù)據(jù)路由經(jīng)過大型網(wǎng)絡(luò) 相當(dāng)于郵局中的排序工人
傳輸層: 提供終端到終端的可靠連接 相當(dāng)于公司中跑郵局的送信職員
會(huì)話層: 允許用戶使用簡單易記的名稱建立連接 相當(dāng)于公司中收寄信、寫信封與拆信封的秘書。關(guān)注公眾號：硬件筆記本
, r; {1 T( }' o! V表示層: 協(xié)商數(shù)據(jù)交換格式 相當(dāng)公司中簡報(bào)老板、替老板寫信的助理
44.模擬信號數(shù)字化的過程是 采樣->量化->編碼
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