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Allegro視頻教程之等長(zhǎng)設(shè)置總結(jié),超詳細(xì)!

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發(fā)表于 2019-3-20 16:08:38 | 只看該作者 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
本帖最后由 Pcbbar 于 2019-3-20 16:11 編輯
* Y0 p3 B- Z* L
5 R) \9 X0 s) E
  很多Allegro視頻教程里可能都沒(méi)有講到等長(zhǎng)的設(shè)置,那么對(duì)于看視頻學(xué)習(xí)的人來(lái)說(shuō),allegro視頻教程哪家好就是一個(gè)我們值得重視的問(wèn)題了。對(duì)此,凡億的老師們整理了一套Allegro的等長(zhǎng)設(shè)置總結(jié),接下來(lái)先看看吧!
  通常情況,需要控制等長(zhǎng)的信號(hào)線,絕不是一根,這樣我們可以根據(jù)情況進(jìn)行分類處理。這里以DDR2為例,介紹如何通過(guò)BUS來(lái)設(shè)置等長(zhǎng)約束。打開(kāi)CM,進(jìn)行電氣規(guī)則設(shè)置。
如下圖
  看過(guò)凡億的Allegro視頻教程都知道,哪些信號(hào)應(yīng)該分在一組,對(duì)于設(shè)計(jì)者來(lái)說(shuō),應(yīng)該心里很清楚。在我們打開(kāi)CM的電氣規(guī)則后,先進(jìn)行分組,如上的案子,有兩片DDR2.就把數(shù)據(jù)線每8根分一組.然后在加上該組信號(hào)的數(shù)據(jù)領(lǐng)存信號(hào)和掩碼信號(hào)。關(guān)于BUS的設(shè)置操作,如下圖
簡(jiǎn)單說(shuō)一下步驟:
   選中信號(hào)一右鍵選擇create---接著選擇下級(jí)菜單中的BUS。接下來(lái)會(huì)彈出一個(gè)對(duì)話框.如下圖。在BUS欄中填上合適的名稱,點(diǎn)擊OK就完成了BUS的創(chuàng)建。
如果創(chuàng)建BUS后,發(fā)現(xiàn)某一個(gè)信號(hào)或者幾個(gè)信號(hào)翻選了,此時(shí)再把它們添加進(jìn)剛才的BUS就可以了。如下圖:
同樣會(huì)彈出對(duì)話框,如下圖:
如此就完成了BUS的創(chuàng)建。個(gè)人認(rèn)為在這里對(duì)信號(hào)創(chuàng)建BUS進(jìn)行區(qū)分,顯得更加有條理。
接著設(shè)置等長(zhǎng)規(guī)則,這里先介紹一種比較直接的方法。
1.  選中剛才創(chuàng)建的BUS名稱,右鍵點(diǎn)擊SiXplorer..彈出如下的值號(hào)拓?fù)淠P?font face="宋體">:
2.  在這個(gè)模型界面,進(jìn)行設(shè)里
3.  彈出如下的對(duì)話框,在其中進(jìn)行設(shè)置
  先選中上圖"1"指向的按鈕Rel Prop Delay,然后在rule name處命一個(gè)名稱From和To左面顯示的也有,就是要做等長(zhǎng)的信號(hào)線的兩個(gè)點(diǎn),分別點(diǎn)擊選擇,自動(dòng)添加到From和To。
接下來(lái)的選擇可以參考圖中所示elta和Tolerance就是誤差長(zhǎng)度.如Omil和25miI.在繞等長(zhǎng)時(shí),則可以把最長(zhǎng)的和最短的信號(hào)線控制在5Omil.信號(hào)線和參考基準(zhǔn)信號(hào)線間的誤差都會(huì)控制在正負(fù)25md以內(nèi)。這兩個(gè)值可以根據(jù)實(shí)際情況來(lái)更改。最后還需要的操作:分別點(diǎn)擊Add-Apply-0K。然后就會(huì)回到那個(gè)模型的界而,在此把剛才設(shè)置的更新到CM就行了:File--update CM, (constraint manager)。接下來(lái)再指定參考基準(zhǔn)信號(hào)線,就基本完成了等長(zhǎng)規(guī)則的設(shè)置
1.  回到CM中,找到剛才創(chuàng)建的rule name,如下圖:
一般情況,會(huì)看到同一BUS中的信號(hào)線都會(huì)在這個(gè)name的MGrp中。
2.  指定參考基準(zhǔn)。選擇MGrp的name,右鍵analyze一下,在右面會(huì)看到信號(hào)線的長(zhǎng)度。雙擊信號(hào)長(zhǎng)度那一列最上面length,可以進(jìn)行排序,升序或者降序,就看個(gè)人喜好了。設(shè)置參考基準(zhǔn)如下:
接下來(lái)就可以繞等長(zhǎng)了:
1.啟動(dòng)繞等長(zhǎng)的命令:delay tune;
2.相關(guān)的參數(shù)設(shè)置,如下圖:
基本的設(shè)置就如上描述。
這里再說(shuō)一下特殊的情況
1.  創(chuàng)建模型的特殊情況:有時(shí)候添加在同一個(gè)BUS中的信號(hào)的模型不一樣,如在某信號(hào)線加一個(gè)測(cè)試點(diǎn),模型就不一樣了,此時(shí)這根信號(hào)就無(wú)法和其他信號(hào)共用同一個(gè)模型,無(wú)法同時(shí)添加到那個(gè)MGrp。需要單獨(dú)建一下模型,如下圖:
2.和上面創(chuàng)建BUS模型的過(guò)程一樣,記得這個(gè)單獨(dú)的模型的rule name和先前創(chuàng)建的rule name一致,這樣創(chuàng)建完成后,這個(gè)信號(hào)也會(huì)添加到相同的MGrp。
關(guān)于Xnet的設(shè)置
在設(shè)置等長(zhǎng)時(shí),收發(fā)之間可能串接了被動(dòng)元件,如電阻、電容、電感,此時(shí)需要先設(shè)置Xnet,然后再設(shè)置等長(zhǎng)。當(dāng)然,也可分前端和后端分別繞等長(zhǎng)。
Xnet設(shè)置操作如下:
1.  點(diǎn)擊菜單Analyze>SI/EMI Sim>Model…彈出來(lái)的建議定義DC net,直接Yes即可。然后出現(xiàn)下面的Model設(shè)置對(duì)話框:
2. 選擇要?jiǎng)?chuàng)建model的器件:可以直接在板上點(diǎn)選要?jiǎng)?chuàng)建模型的器件,也可以在Detype value/refdes中選擇。
3. 點(diǎn)選create mode...,彈出的對(duì)話框設(shè)置如下:
4. 點(diǎn)擊ok.確定后彈出如下對(duì)話框:
Modename默認(rèn)的沒(méi)問(wèn)題就可以不用動(dòng):Circuit type:根據(jù)情況選擇:Single pins:這里需要注意一下,如1, 16相當(dāng)于同一個(gè)電阻的兩個(gè)pin就連著,接著2、15相當(dāng)于另一個(gè)電阻…。注意不同的pin number之間用空格隔開(kāi),如l和16之間、16和2之間、2和15之間…。
設(shè)置完成后,查看net的Property.會(huì)發(fā)現(xiàn)多一條:Member of XNet....
設(shè)置完成Xnet后,等長(zhǎng)的設(shè)置同上:
再介紹一下另一種設(shè)置等長(zhǎng)的方法:利用Pin Pair創(chuàng)建等長(zhǎng)約束。有時(shí)候創(chuàng)建器件的拓?fù)淠P涂赡懿还苡。就可以用這一招,Allegro視頻教程哪家好,可以繼續(xù)關(guān)注凡億PCB。
1. 在BUS中選中信號(hào)線。同樣的右鍵:create--pin par,在彈出的對(duì)話框中,分別選擇信號(hào)的兩個(gè)端點(diǎn),然后ok就可以了.依次為其他net創(chuàng)建pin pair此時(shí)net的下級(jí)菜單中會(huì)出現(xiàn)lL的東東,這就是剛才創(chuàng)建的pin pair如下圖:
2. 創(chuàng)建match group (MGrp ):選中BUS中所有的ppr,右鍵create...,就不再詳述。漏選的同樣可以用membership來(lái)添加。
3. 完成后,再設(shè)置一下剛剛生成的MGrp就ok了,如下圖:
4. 然后在set target,至此完成設(shè)置。
有時(shí),有些器件的Pin沒(méi)有定義pin type,這時(shí)需要先定義pin type,然后才能設(shè)置pin pair,其操作如下
1.點(diǎn)擊菜單Edit>roperties...:
2.在Find欄位中勾選Pin;
3.在PCB中選中需要修改Pin Type的Pin;
4.在出現(xiàn)的對(duì)話框中做如下圖的設(shè)置:
以上就是Allegro視頻教程等長(zhǎng)設(shè)置總結(jié),超詳細(xì)!Allegro視頻教程哪家好,凡億給你最全面系統(tǒng)的視頻課程講解,專注凡億PCB,讓你的學(xué)習(xí)迅猛增長(zhǎng)!7 T2 c& H. [  R+ |; j

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發(fā)表于 2019-3-20 19:31:11 | 只看該作者
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發(fā)表于 2019-3-21 19:31:54 | 只看該作者
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看看看看看看看看看看看看, S) q" i5 {- O: P

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