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[Cadence] Omapl138+XC6 Xilinx FPGA核心板 原理圖+PCB

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發(fā)表于 2020-7-9 14:19:17 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式
本帖最后由 XSS_JZK 于 2020-7-9 14:22 編輯

電源時序需要自己單獨處理一下，如果想用來打板可以與我聯(lián)系，我會告訴你怎么改電源部分。
板子為8層板，DSP與FPGA通過總線相連，引出了FPGA的所有管腳。
電源時序部分需要處理一下，自己懶得搞了，如果有想用的，可以聯(lián)系我，我告訴怎么改這個時序。
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發(fā)表于 2020-7-24 16:37:03 | 只看該作者
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發(fā)表于 2020-7-24 21:47:30 | 只看該作者
謝謝分享Omapl138+XC6 Xilinx FPGA核心板 原理圖+PCB
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發(fā)表于 2020-8-19 08:10:27 來自手機 | 只看該作者
電源時序部分可否指導下 郵箱724344808@qq.com
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發(fā)表于 2021-1-25 15:00:28 | 只看該作者

大神，麻煩指導下電源時序部分，謝謝��！ 郵箱danruhai@163.com
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發(fā)表于 2021-5-2 07:48:29 | 只看該作者
大神，麻煩指導下電源時序部分
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發(fā)表于 2021-5-4 10:00:28 | 只看該作者
了解一下 謝謝分享
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發(fā)表于 2021-10-11 15:38:17 | 只看該作者

電源時序部分可否指導下 郵箱229312963@qq.com
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發(fā)表于 2021-10-30 20:41:30 | 只看該作者
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