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[作業(yè)已審核] 王靚——DRRX2模塊PCB設(shè)計(jì)作業(yè)

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發(fā)表于 2024-9-23 00:00:53 | 只看該作者 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
布局：

1）畫SOC器件的中心輔助線，將2片DDR中心對(duì)齊擺放；
2）將一個(gè)DDR中間錯(cuò)位打孔扇出，另一個(gè)復(fù)制；
3）SOC自動(dòng)扇出（8-14mil過孔）；
4）將DDR的地址和數(shù)據(jù)信號(hào)按組分類；
布線：
1）先將4組數(shù)據(jù)信號(hào)與SOC進(jìn)行點(diǎn)對(duì)點(diǎn)的連通，同組同層；
2）地址信號(hào)通過2片DDR之間的連接孔與SOC連通；
3）數(shù)據(jù)信號(hào)等長處理，正負(fù)25mil；
4）地址信號(hào)等長處理，正負(fù)50mil；
5）電源層連通，及濾波電容擺放處理；

DDRX2.brd

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沙發(fā)
發(fā)表于 2024-9-23 11:08:00 | 只看該作者
濾波電容放在背面，效果會(huì)更好一些

該會(huì)員沒有填寫今日想說內(nèi)容.
板凳
發(fā)表于 2024-9-23 11:09:48 | 只看該作者
VREF這個(gè)電源不要走在電源層

該會(huì)員沒有填寫今日想說內(nèi)容.
地板
發(fā)表于 2024-9-23 11:10:10 | 只看該作者
其它沒什么大問題
該會(huì)員沒有填寫今日想說內(nèi)容.

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發(fā)表于 2024-10-13 22:11:00 | 只看該作者
cesc 發(fā)表于 2024-9-23 11:10
其它沒什么大問題

已修改：1）VREF電源移至底層；2）頂層濾波電容移至底層就近擺放；

DDRX2.brd

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