電子產(chǎn)業(yè)一站式賦能平臺

PCB聯(lián)盟網(wǎng)

搜索
查看: 89|回復(fù): 0
收起左側(cè)

Hot Chips 2024 | 人工智能在芯片設(shè)計中的應(yīng)用

[復(fù)制鏈接]

441

主題

441

帖子

3200

積分

四級會員

Rank: 4

積分
3200
跳轉(zhuǎn)到指定樓層
樓主
發(fā)表于 2024-9-19 08:00:00 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式
引言4 d5 ]9 a$ E+ X
人工智能(AI)正在深刻改變半導(dǎo)體行業(yè),特別是在芯片設(shè)計過程中。本文探討AI如何重塑芯片設(shè)計的各個方面,包括分析、優(yōu)化和設(shè)計輔助,幫助逍遙設(shè)計自動化的讀者了解不同的AI技術(shù)及其在提高設(shè)計性能和生產(chǎn)力方面的應(yīng)用[1]。; Y5 V' r3 D( ]3 `
3 f8 h) n3 x5 ^- G- Y0 m6 }
人工智能在芯片設(shè)計中的應(yīng)用簡介, V# o* N' U7 [, A% S2 r
AI正在芯片設(shè)計行業(yè)掀起波瀾,提升設(shè)計過程的多個階段。AI主要影響以下關(guān)鍵領(lǐng)域:
  • 分析:AI實現(xiàn)更快速、預(yù)測性和跨階段的芯片設(shè)計分析。
  • 優(yōu)化:AI驅(qū)動的優(yōu)化技術(shù)帶來更快速、更可擴展和更優(yōu)質(zhì)的結(jié)果。
  • 輔助:AI為芯片設(shè)計師提供專業(yè)知識、編碼支持和任務(wù)自動化。& j% f5 q2 S* P8 Q& ~/ a$ y# }
    [/ol]/ R, @6 ?8 p6 ^% R( [

    1 v! k/ K3 `! Y+ l0 x " n! }' M5 Q* e7 J/ q$ v. x6 @
    圖1:此圖展示了AI在芯片設(shè)計中影響的主要領(lǐng)域:分析、優(yōu)化和輔助。
    ! z1 s: M! d, j0 g  {' m# J
    $ \! o: ?. J- B芯片設(shè)計中的AI技術(shù)+ H/ P+ d  J' W2 Y% J$ o
    多種AI技術(shù)被應(yīng)用于芯片設(shè)計,每種技術(shù)適用于設(shè)計過程的不同方面:
  • 經(jīng)典機器學(xué)習(xí)(ML):適用于小型結(jié)構(gòu)化數(shù)據(jù),線性回歸、支持向量機和決策樹等技術(shù)用于初步分析。
  • 深度學(xué)習(xí):卷積神經(jīng)網(wǎng)絡(luò)(CNN)適合物理設(shè)計數(shù)據(jù),而圖神經(jīng)網(wǎng)絡(luò)(GNN)適合線路網(wǎng)表數(shù)據(jù)。
  • 貝葉斯優(yōu)化:此技術(shù)用于構(gòu)建目標(biāo)函數(shù)的概率模型,并選擇最有希望的數(shù)據(jù)點進(jìn)行采樣。
  • 強化學(xué)習(xí)(RL):RL代理通過與環(huán)境交互并獲得改進(jìn)獎勵來學(xué)習(xí)優(yōu)化設(shè)計。
  • 生成式AI:這些模型,包括變分自編碼器(VAE)和Transformer,用于生成最佳設(shè)計點和學(xué)習(xí)優(yōu)化表示。
  • 大型語言模型(LLM):LLM用途廣泛,可應(yīng)用于問答、編碼、提取、重寫、分類、總結(jié)和推理等多種任務(wù)。! j/ C9 R% o5 ^' Z* O* o8 n% U5 _
    [/ol]
    ( H. ^" \+ y+ l  w2 D3 e! \, z6 P  X7 u, _& N& n2 _

    ( D4 g6 m1 C3 a% u# E! |圖2:NVIDIA芯片設(shè)計中使用的不同AI技術(shù),包括經(jīng)典ML、深度學(xué)習(xí)和各種優(yōu)化方法。
    : j2 M1 {/ n- B, G# l9 B- I/ f2 q7 T! x
    AI在芯片設(shè)計中的應(yīng)用* U  K, G; _+ W& h( Z3 A' ^: v
    讓我們探討AI在芯片設(shè)計中的一些具體應(yīng)用:
    9 S9 w2 I+ _1 G$ U% g5 K1. IR壓降估算
    + ]% U0 n' c9 [- L+ f& S6 aIR壓降估算對物理設(shè)計非常重要,但傳統(tǒng)方法需要數(shù)小時。基于AI的方法可以從單元級特征預(yù)測IR壓降,在3秒內(nèi)實現(xiàn)94%的準(zhǔn)確率,而商業(yè)工具需要3小時。
    0 \  P. G8 m2 l: Y" H$ h- f. [: H4 I

    5 Z& c, x" _( T6 f3 t5 b: z圖3:使用AI進(jìn)行IR壓降估算的過程,顯示了功率圖和系數(shù)圖。
    ! W+ d7 C8 U- h  J0 ]- B$ q
    : d# l/ _5 x+ w6 e- L2. 寄生參數(shù)預(yù)測' p) Y0 B, X5 @, X
    AI用于從原理圖預(yù)測布局寄生參數(shù)。通過將原理圖轉(zhuǎn)換為圖形并使用圖神經(jīng)網(wǎng)絡(luò)(GNN),設(shè)計師可以高精度估算寄生參數(shù),將仿真誤差降低到10%以下。
    + a0 A: w% w+ }7 k
    : e9 T( K1 ^  b, D
    & \/ A) t2 y, B$ i圖4:此圖說明了將線路原理圖轉(zhuǎn)換為異構(gòu)圖以進(jìn)行寄生參數(shù)預(yù)測的過程。
    ) E0 \, j1 R5 s- M( \1 G9 f% S3 |" }3 c5 Q  n
    3. 宏單元布局優(yōu)化
    9 D0 r( W1 y0 }8 p2 G% R宏單元布局對物理設(shè)計非常關(guān)鍵。多目標(biāo)貝葉斯優(yōu)化被用于改進(jìn)宏單元布局,考慮線長、擁塞度和密度等因素。9 G: }$ f/ C3 [2 n; d

    ( b  L& O# U/ f% B+ Y , J& B# e- @5 m+ }# E
    圖4:此圖比較了基準(zhǔn)宏單元布局與使用AutoDMP(自動化DREAMPlace基礎(chǔ)宏單元布局)優(yōu)化后的布局。" T1 V4 H# H  F% V5 |, }

    8 l% I* f4 Q+ W+ S  C4. 設(shè)計規(guī)則檢查(DRC)修復(fù)
    ) a. f1 v- J* x0 c強化學(xué)習(xí)代理被訓(xùn)練用于自動修復(fù)單元布局中的設(shè)計規(guī)則檢查(DRC)違規(guī)。代理學(xué)習(xí)逐步減少DRC錯誤,最終得到干凈的布局。
    . f) ?1 g" X$ v1 y# d: v, ^; z- n6 f% f  }) V" T. ~7 y1 [

    . Y3 E" w0 \7 z圖5:此圖顯示了RL代理在單元布局中修復(fù)DRC違規(guī)的逐步過程。
    # X, Q' M6 C, u9 m" J4 P4 {% M$ f7 M5 q" a0 T) `
    5. 數(shù)據(jù)通路優(yōu)化# L6 H7 H) ~8 \' X+ V' _, X# K5 S
    強化學(xué)習(xí)也被應(yīng)用于優(yōu)化數(shù)據(jù)通路結(jié)構(gòu),如前綴加法器。RL代理探索不同的前綴圖結(jié)構(gòu),以實現(xiàn)比知名加法器架構(gòu)更好的性能。
    # q- r$ @) K5 [! D
    . @& k  @8 ?2 r3 R . D0 L8 d, G3 [/ x) H
    圖6:此圖說明了使用強化學(xué)習(xí)優(yōu)化前綴加法器結(jié)構(gòu)的過程。
    " R  h+ B* w2 }  q' X3 {
    4 t: m; r% ~! E9 J; P* x6. 門尺寸調(diào)整" L" Q" F) s6 C- W" A0 s
    Transformer被用于生成最佳門尺寸,以進(jìn)行時序和功耗優(yōu)化。通過將門路徑建模為序列,AI可以生成優(yōu)化的門尺寸,與傳統(tǒng)優(yōu)化方法相比,實現(xiàn)了100倍到1000倍的加速。
    ' ~" k4 A4 S' p, y6 I; }% S
    3 L0 y5 o3 A  M) `3 g( m + l9 _8 |0 f! \0 N
    圖7:此圖顯示了Transizer方法在門尺寸優(yōu)化中實現(xiàn)的功耗/延遲權(quán)衡。. ^2 f; X; r0 |' _$ m
    5 x! o2 g$ m( y
    7. 加速器設(shè)計5 N3 [# t" f' f
    變分自編碼器(VAE)被用于學(xué)習(xí)硬件加速器設(shè)計的連續(xù)可重構(gòu)潛在空間。這種方法在探索設(shè)計空間時實現(xiàn)了6.8倍的樣本效率和5%的性能提升。
    , H! {' P1 S8 Q& L7 J5 a3 i; q; `6 j/ `9 Z/ k0 v( M4 T, r  M8 n

    0 R  @" W9 q5 t0 I圖8:此圖展示了在神經(jīng)網(wǎng)絡(luò)加速器設(shè)計空間優(yōu)化中使用VAE的過程。
    * x% B" ~" W3 v, l
    % R* h8 a# a3 W% D& J- m大型語言模型在芯片設(shè)計中的應(yīng)用
    ( c$ Q+ b! a* P% {大型語言模型(LLM)在芯片設(shè)計中越來越重要?梢酝ㄟ^以下技術(shù)適應(yīng)各種任務(wù):
    8 u9 x$ R8 e4 W0 \  k: Z2 P' Z" T! I
  • 參數(shù)訓(xùn)練
  • 檢索增強生成(RAG)
  • 上下文學(xué)習(xí)
  • 基于代理的方法8 P! j/ @( a: T- ]! P0 W9 V* v
    % z6 J; ]# b( i% m  u' h
    LLM在芯片設(shè)計中用于多個目的:
  • 編碼輔助:為特定任務(wù)生成EDA腳本。
  • 專業(yè)知識輔助:回答關(guān)于設(shè)計、基礎(chǔ)設(shè)施、工具和流程的問題。
  • 分析輔助:總結(jié)錯誤報告并預(yù)測任務(wù)分配。3 M/ {! Y( X3 y5 ]4 j: }
    [/ol]5 M5 f/ q7 p8 v" J# l' {

    ( \7 i$ _$ k: q' l# u/ m; T, ` % C; q! [; O8 d  m" ]% ~4 U
    圖9:此圖顯示了LLM在芯片設(shè)計中的各種應(yīng)用,包括編碼、專業(yè)知識、分析、優(yōu)化和調(diào)試輔助。
    ) h7 l6 u4 B8 O: r  C
    2 j/ J! }2 k0 p( q5 m結(jié)論
    ; r. q" p+ @- ?AI正在通過提高分析速度、優(yōu)化質(zhì)量和設(shè)計輔助來革新芯片設(shè)計。隨著該領(lǐng)域的進(jìn)展,可以期待看到:
  • 持續(xù)使用貝葉斯優(yōu)化和強化學(xué)習(xí),以實現(xiàn)芯片設(shè)計中更好的PPA(功耗、性能、面積)。
  • 在優(yōu)化數(shù)據(jù)上訓(xùn)練的生成式AI模型,加速傳統(tǒng)優(yōu)化過程。
  • LLM模型和代理通過聊天機器人、協(xié)作工具和任務(wù)自動化顯著提高芯片設(shè)計生產(chǎn)力。
  • 可靠高效的推理基礎(chǔ)設(shè)施的重要性日益增加。4 A, p; _; \, ]9 x& w
    [/ol]" |% r5 K( Y0 d% |- J
    為進(jìn)一步推動該領(lǐng)域發(fā)展,需要更多數(shù)據(jù)集和基準(zhǔn),如VerilogEval、FVEval和LLM4HWDesign。隨著AI的不斷發(fā)展,其在芯片設(shè)計過程中的集成無疑將帶來更高效、更強大和更創(chuàng)新的半導(dǎo)體產(chǎn)品。
    6 k. {/ f" K. e# U$ t4 h0 x) X3 a7 \3 H; k+ [

    % ~) W0 h" g1 K- f6 N0 _3 \1 n參考文獻(xiàn)% B, \; K0 i# p) d
    [1] H. Ren, "Introduction to AI for Chip Design," presented at Hot Chips, Aug. 25, 2024.% j! A# o) P: \4 n, c; X9 O
    1 e- a: h& ^) E* f/ \
    - END -3 `( {/ n, O1 ~% b& g7 s! r

    2 L, s; Q: i+ [& b) F2 i軟件申請我們歡迎化合物/硅基光電子芯片的研究人員和工程師申請體驗免費版PIC Studio軟件。無論是研究還是商業(yè)應(yīng)用,PIC Studio都可提升您的工作效能。2 D5 r% T0 n. b" i  R
    點擊左下角"閱讀原文"馬上申請& v* g" R5 J# b! j

    " l7 z" c$ e! ]" K! @5 G7 J歡迎轉(zhuǎn)載
    / Z9 S6 l$ E2 `6 ]" o: g& s
    1 l1 s$ e/ V; n# E8 H1 _3 O% g4 l轉(zhuǎn)載請注明出處,請勿修改內(nèi)容和刪除作者信息!
    3 e) f3 F) `* k+ E
    - Q/ O) L1 S& N/ P& R/ g" o9 @: T$ `0 h4 s
    8 y0 O; ]3 e6 w0 v& ~

    ) b. C' J! o# [- u
    , p% M' D% Z. O+ Q: D  F% I關(guān)注我們
    - V% }7 x$ r+ W1 w% T& C
    : i9 }. ?( m) z0 y; k( I
    ) G3 x% J! O8 Q

    + f/ s, {5 S+ E( u+ R
    1 ?" v( ]& b5 H( i# y
    : J  j  T  r9 O5 E& c$ b8 Q5 g
      v  }8 {) {* U* k: C7 k8 Z- ?
    ( G) Q! i- {* n  D) q- V
                          " k& N9 u/ O# T0 V" q
    - [% s. P, H5 a. b; v6 c

    * S& c8 \; v) L$ q8 O# k$ Y/ N
    * B+ O0 N# q+ F* X7 `$ E! F
    0 w9 v# ~4 S  F! s

    3 L, |% y  t. p! i6 n3 B. ~* [
    " y8 [# {; l& C( I; n5 n
    關(guān)于我們:
    . M* x3 p! X4 g4 J/ z深圳逍遙科技有限公司(Latitude Design Automation Inc.)是一家專注于半導(dǎo)體芯片設(shè)計自動化(EDA)的高科技軟件公司。我們自主開發(fā)特色工藝芯片設(shè)計和仿真軟件,提供成熟的設(shè)計解決方案如PIC Studio、MEMS Studio和Meta Studio,分別針對光電芯片、微機電系統(tǒng)、超透鏡的設(shè)計與仿真。我們提供特色工藝的半導(dǎo)體芯片集成電路版圖、IP和PDK工程服務(wù),廣泛服務(wù)于光通訊、光計算、光量子通信和微納光子器件領(lǐng)域的頭部客戶。逍遙科技與國內(nèi)外晶圓代工廠及硅光/MEMS中試線合作,推動特色工藝半導(dǎo)體產(chǎn)業(yè)鏈發(fā)展,致力于為客戶提供前沿技術(shù)與服務(wù)。
    * p& s  y2 \( y2 G
    $ N; Q' @6 K  |+ ?. E% n& A, N/ \http://www.latitudeda.com/
    7 t4 f, n! e2 w(點擊上方名片關(guān)注我們,發(fā)現(xiàn)更多精彩內(nèi)容)
  • 回復(fù)

    使用道具 舉報

    發(fā)表回復(fù)

    您需要登錄后才可以回帖 登錄 | 立即注冊

    本版積分規(guī)則

    關(guān)閉

    站長推薦上一條 /1 下一條


    聯(lián)系客服 關(guān)注微信 下載APP 返回頂部 返回列表